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題名 | 運用空間相關性分析之混合訊號電路良率評估器=Yield Evaluator of Mixed-Signal Circuit Using Spatial Correlation Analysis |
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作者 | 羅珮文; 陳竹一; 魏慶隆; Lu, Pei-wen; Chen, Jwu-e; Wey, Chin-long; |
期刊 | 系統晶片 |
出版日期 | 20081200 |
卷期 | 9 2008.12[民97.12] |
頁次 | 頁87-95 |
分類號 | 448.532 |
語文 | chi |
關鍵詞 | 電路設計; 良率分析; 元件實體佈局; |