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題 名:
使用分離式時脈電網增進超低電壓晶片良率:Separate Clock Network Voltage for Yield Improvement of Ultra-Low-Voltage ICs
- 作 者:
- 書刊名:
- 卷 期:
156 2014.04[民103.04]
- 頁 次:
頁83-90
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題 名:
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題 名:
低電壓靜態隨機存取記憶體電路設計及分析:Low Voltage Static Random Access Memory Design and Analysis
- 作 者:
- 書刊名:
- 卷 期:
150 2013.04[民102.04]
- 頁 次:
頁37-44
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題 名: