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題 名:
使用分離式時脈電網增進超低電壓晶片良率:Separate Clock Network Voltage for Yield Improvement of Ultra-Low-Voltage ICs
- 作 者:
- 書刊名:
- 卷 期:
156 2014.04[民103.04]
- 頁 次:
頁83-90
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題 名:
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
154 2013.12[民102.12]
- 頁 次:
頁5-10
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
165 2016.03[民105.03]
- 頁 次:
頁34-41
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題 名:
多媒體平臺晶片之低功率實現方法:Low Power Methodology Development for Multimedia Platform
- 作 者:
- 書刊名:
- 卷 期:
132 2010.04[民99.04]
- 頁 次:
頁103-113
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題 名:
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
4 民95.04
- 頁 次:
頁127-143
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
2020:3 2020.09[民109.09]
- 頁 次:
頁97-108