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題 名:
深次微米佈局設計及驗證環境之建立:Deep-Submicron Layout Design & Verification Environment Setup
- 作 者:
- 書刊名:
- 卷 期:
72 1998.09[民87.09]
- 頁 次:
頁46-55
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題 名:
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題 名:
A Reliable Clock Tree Design Methodology for ASIC Designs:高品質的積體電路時鐘樹之設計方法
- 作 者:
- 書刊名:
- 卷 期:
28:3 2000.09[民89.09]
- 頁 次:
頁115-122
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題 名:
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
62 1997.09[民86.09]
- 頁 次:
頁28-31
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題 名:
時鐘樹之標準延遲格式檔案產生器:Precise SDF Files Generation for Clock Trees
- 作 者:
- 書刊名:
- 卷 期:
62 1997.09[民86.09]
- 頁 次:
頁32-39
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題 名:
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題 名:
Implementing Optimal Clock Schedule with Minimum Cost:以最小成本實現最佳非零時序差異排序的時鐘樹設計方式
- 作 者:
- 書刊名:
- 卷 期:
31:3 2003.09[民92.09]
- 頁 次:
頁221-231
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題 名:
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題 名:
Clock Tree Optimization for the Tolerance of Process Variation:具製程變異容忍度之時鐘樹最佳化
- 作 者:
- 書刊名:
- 卷 期:
33:3 民94.09
- 頁 次:
頁513-518
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題 名:
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題 名:
Performance and Power Driven Non-Zero Skew Clock Tree Design Methodology:效能及攻率導向之非零時序差異時鐘樹設計方法
- 作 者:
- 書刊名:
- 卷 期:
32:3 2004.09[民93.09]
- 頁 次:
頁401-407
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題 名: