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題 名:
深次微米佈局設計及驗證環境之建立:Deep-Submicron Layout Design & Verification Environment Setup
- 作 者:
- 書刊名:
- 卷 期:
72 1998.09[民87.09]
- 頁 次:
頁46-55
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題 名:
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題 名:
A Reliable Clock Tree Design Methodology for ASIC Designs:高品質的積體電路時鐘樹之設計方法
- 作 者:
- 書刊名:
- 卷 期:
28:3 2000.09[民89.09]
- 頁 次:
頁115-122
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題 名:
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
62 1997.09[民86.09]
- 頁 次:
頁28-31
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題 名:
時鐘樹之標準延遲格式檔案產生器:Precise SDF Files Generation for Clock Trees
- 作 者:
- 書刊名:
- 卷 期:
62 1997.09[民86.09]
- 頁 次:
頁32-39
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題 名:
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題 名:
Implementing Optimal Clock Schedule with Minimum Cost:以最小成本實現最佳非零時序差異排序的時鐘樹設計方式
- 作 者:
- 書刊名:
- 卷 期:
31:3 2003.09[民92.09]
- 頁 次:
頁221-231
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題 名:
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題 名:
可電壓控制之電源模式感知時脈樹:Voltage-controllable Power-mode-aware Clock Tree
- 作 者:
- 書刊名:
- 卷 期:
154 2013.12[民102.12]
- 頁 次:
頁11-16
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題 名:
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
26:6 2010.11[民99.11]
- 頁 次:
頁2249-2266
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
25:6 2009.11[民98.11]
- 頁 次:
頁1651-1670
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
25:6 2009.11[民98.11]
- 頁 次:
頁1707-1722
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
37:1 2004.03[民93.03]
- 頁 次:
頁223-232
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題 名:
Self-adjusting Mechanism for Reducing the Impact of PVT Variations on Clock Skew:
- 作 者:
- 書刊名:
- 卷 期:
21:6 2014.12[民103.12]
- 頁 次:
頁225-233
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題 名:
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題 名:
廣域電壓之電源模式感知時脈樹設計:Power-mode-aware Clock Tree Synthesis for Wide-voltage-range Designs
- 作 者:
- 書刊名:
- 卷 期:
163 2015.09[民104.09]
- 頁 次:
頁96-102
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題 名:
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題 名:
Low-power Fast-lock Delay-recycled Clock Skew-compensation and/or Duty-cycle-correction Circuit:
- 作 者:
- 書刊名:
- 卷 期:
19:2 2012.04[民101.04]
- 頁 次:
頁85-94
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題 名:
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題 名:
A Skew-Window Based Methodology for Timing Fixing in Multiple Power Modes:
- 作 者:
- 書刊名:
- 卷 期:
31:5 2015.09[民104.09]
- 頁 次:
頁1795-1812
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題 名:
被引用次數:期刊(0) 博士論文(0) 專書(0) 專書論文(0)