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使用90nm CMOS製程設計一轉換增益24.6±1.5 dB、雜訊指數5.6±0.8 dB及34.4mW之58~66GHz接收機前端電路:A 34.4 mW 58~66 GHz Receiver Front-End with 24.6±1.5 dB Conversion Gain and 5.6±0.8 dB Noise Figure in 90 nm CMOS
王建今 林佑昇 李仁豪
奈米通訊
22:3 2015.09[民104.09]
頁25-30
TCI引用統計