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題 名:
28×22位元管線式乘法器之HDL設計與模擬:The HDL Design and Simulation of a 28×22bit Pipeline Multiplier
- 作 者:
- 書刊名:
- 卷 期:
24 2010.08[民99.08]
- 頁 次:
頁433-452
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題 名:
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
17:4 2010.08[民99.08]
- 頁 次:
頁241-250