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題 名:
VLSI Chip Design of Viterbi Decoder with Reduced-state Algorithm:一種減少狀態點數魏特比解碼器之超大型積體電路晶片設計
- 作 者:
- 書刊名:
- 卷 期:
28:1 1995.03[民84.03]
- 頁 次:
頁197-210
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題 名:
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
558 1995.02[民84.02]
- 頁 次:
頁52-61
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
12:3 1995.09[民84.09]
- 頁 次:
頁260-265
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
14:4=56 1995.10[民84.10]
- 頁 次:
頁24-43
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
12:2 1995.06[民84.06]
- 頁 次:
頁192-198
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
55 1995.07[民84.07]
- 頁 次:
頁117-129