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題 名:
A Uniform VLSI Architecture for Modulo n Adder/Subtracter and Multiplier:一個均勻的模組n加法器/減法器與乘法器之VLSI架構
- 作 者:
- 書刊名:
- 卷 期:
8:1 2001.02[民90.02]
- 頁 次:
頁9-20
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題 名:
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題 名:
Multiplierless FIR Filter Architecture Synthesizer Based on CSD Code:以標準符號數位碼為基礎的無乘法器有限脈衝響應濾波器合成器
- 作 者:
- 書刊名:
- 卷 期:
10:2 2003.05[民92.05]
- 頁 次:
頁155-163
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題 名: