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- 題 名:
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- 卷 期:
31:2 1998.09[民87.09]
- 頁 次:
頁43-56
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題 名:
一個自動化的IC佈局封裝接點擺置順序設計環境:An Automatic IC Layout Pad Assignment Design Environment
- 作 者:
- 書刊名:
- 卷 期:
72 1998.09[民87.09]
- 頁 次:
頁26-31
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題 名:
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題 名:
Layer Assignment for Multi-layer PCB and VLSI Routing:多層PCB 與VLSI佈線中的佈局層指定
- 作 者:
- 書刊名:
- 卷 期:
14:4 1991.07[民80.07]
- 頁 次:
頁373-382
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題 名:
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題 名:
A Reliable Clock Tree Design Methodology for ASIC Designs:高品質的積體電路時鐘樹之設計方法
- 作 者:
- 書刊名:
- 卷 期:
28:3 2000.09[民89.09]
- 頁 次:
頁115-122
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題 名:
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
34:1 2001.03[民90.03]
- 頁 次:
頁99-107
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題 名:
超大型積體電路佈局設計工具的資料結構技術:Data Structuring Techniques for VLSI Layout Tools
- 作 者:
- 書刊名:
- 卷 期:
11 2000.04[民89.04]
- 頁 次:
頁216-222
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題 名:
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題 名:
接線負載模型的建立和應用:The Creation and Application of Wire Load Model in ASIC Design
- 作 者:
- 書刊名:
- 卷 期:
62 1997.09[民86.09]
- 頁 次:
頁21-27
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題 名:
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
62 1997.09[民86.09]
- 頁 次:
頁28-31
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題 名:
時鐘樹之標準延遲格式檔案產生器:Precise SDF Files Generation for Clock Trees
- 作 者:
- 書刊名:
- 卷 期:
62 1997.09[民86.09]
- 頁 次:
頁32-39
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題 名:
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
52 1996.09[民85.09]
- 頁 次:
頁30-38
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題 名:
細胞元式類神經網路之設計及其積體電路實現:Design of Cellular Neural Networks and Their VLSI Implementation
- 作 者:
- 書刊名:
- 卷 期:
23 2003.07[民92.07]
- 頁 次:
頁183-198
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題 名:
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題 名:
邊緣剪線技術應用於單元佈局壓縮:Edged Shear Line Techniques Applied to Cell Compaction
- 作 者:
- 書刊名:
- 卷 期:
35:1 2002.03[民91.03]
- 頁 次:
頁103-113
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題 名:
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
42 1995.09[民84.09]
- 頁 次:
頁71-79
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
2 1995.06[民84.06]
- 頁 次:
頁267-274
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
60 1994.02[民83.02]
- 頁 次:
頁103-121
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
26 1994.02[民83.02]
- 頁 次:
頁17-23
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
26 1994.02[民83.02]
- 頁 次:
頁24-28
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
55 1992.06[民81.06]
- 頁 次:
頁65-90
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- 題 名:
- 作 者:
- 書刊名:
- 卷 期:
22:1 2005.03[民94.03]
- 頁 次:
頁20-24
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題 名:
Combining the Area Partition with Circuit Partition for VLSI Placement:結合面積分割與線路分割的超大型積體電路佈局
- 作 者:
- 書刊名:
- 卷 期:
21 1991.11[民80.11]
- 頁 次:
頁131-140
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